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FPGA용 OpenCL을 사용한 2백만 포인트 주파수 도메인 필터 설계 | 반도체네트워크

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FPGA용 OpenCL을 사용한 2백만 포인트 주파수 도메인 필터 설계

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이 글에서는 120~240 MSPS(million samples per second)에 이르는 다양한 샘플 속도를 지원하는 현행 FPGA 아키텍처로 1백만~1600만 포인트에 이르는 주파수 도메인 필터를 설계할 수 있다는 것을 설명하려고 한다. 그러한 예로서 OpenCL을 사용해서 2백만 포인트 단정도 주파수 도메인 필터를 설계하는 것에 대해서 설명한다. 이 글은 독자들이 FPGA 설계와 OpenCL의 기본 개념을 충분히 이해하고 있는 것으로 간주하고 있다.

leekh@seminet.co.kr
(끝)
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